沪S3公路1标主线高架桥工程贯通年底前全线通车

基于DBL结构的嵌入式64kb SRAM的低功耗设计

针对嵌入式系统的低功耗要求，采用位线分割结构和存储阵列分块译码结构，完成了64 kb低功耗SRAM模块的设计。与一般布局的存储器相比，采用这两种技术使存储器的功耗降低了43% ，而面积仅增加了18%。
关键字： DBL 嵌入式系统 SRAM 低功耗嵌入式

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