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约250对“统一教”邪教信徒持AR-15机枪参加集体婚礼

鼎阳科技SDS7000A数字示波器再升级!

  • 2025-08-03,深圳市鼎阳科技股份有限公司在SDS7000A系列数字示波器基础上发布了SDS7000AP新型号,模拟带宽8GHz和6GHz,最大存储深度升级为2Gpts/ch,全通道采样率升级为20GSa/s,进一步丰富了鼎阳科技高带宽高分辨率数字示波器产品线。SDS7000AP新增MIPI、DDR等多种协议一致性测试和分析功能,可广泛应用于高速信号测试、嵌入式设计、汽车电子等相关领域,再一次打破自身保持的记录,树立国产高分辨率示波器新标杆!随着日常通信系统中的信号速率越来越快,多点位高速信号测试
  • 关键字: 鼎阳  数字示波器  

由数字示波器的方波拐角引发的思考:时域VS频域

  •  对于大多数电子工程师来说,时域的信号是非常直观和容易理解的,因为时域是一个真实世界,是实际存在的域。我们所有的经历都是在时域中发展和验证,而且大家都已经习惯了事件是按照时间先后顺序发生的,并得到记录保存。    鼎阳科技为广大的电子工程师提供了一系列不同的数字示波器,用以对我们感兴趣的时域信号进行捕获、观察、测量、分析和存档。相信大家很容易就能够理解数字示波器的基本工作原理并熟练掌握对数字示波器的使用和操作方法。但是,一个信号是否真的就像看起来那样“纯洁无瑕”、“
  • 关键字: 数字示波器  方波拐角  时域  频域   

数字示波器使用要注意哪些

  • 在使用数字示波器时要注意的问题很多,如果操作不规范就会导致很多数据的不准确,再者就是容易把数字示波器弄坏,严重操作不当可能还会对安全有影响。那么数字示波器使用要注意哪些呢?1、一般在使用时要求被测量设备和测量设备都应可靠连接参考地,如果不能满足条件时应使用隔离系统做好隔离后才能进行测量,例如:可使用隔离变压器,示波器可使用电池供电,使用隔离探头等等。2、一般数字示波器配合探头使用时,只能测量(被测信号到信号地就是大地)信号端输出幅度小于300V CAT II信号的波形。绝对不能测量市电AC220V 或与市
  • 关键字: 数字示波器  

数字示波器的波形捕获率真的有那么高吗?

  • 数字示波器作为电子工程师最常用的仪器,从最开始的模拟示波器,到数字存储示波器和数字荧光示波器,以及越来越偏向专业化的定制类示波器,功能越来越丰富的同时,性能也发生着日新月异的变化,消费者在选择的时候有时候就可能看得眼花缭乱,那么如何选择适合自己的一款示波器呢?我们知道示波器三大核心指标是带宽、采样率、存储深度,然而在选择数字示波器时还有一个很重要的指标往往会被忽略,那就是我们今天要讲的波形刷新率,也称为波形捕获率!波形捕获率是相对于数字示波器来说的。数字示波器采样、处理数据到送显屏幕都是需要时间的,处理数
  • 关键字: 数字示波器  波形捕获率  

数字示波器抖动噪声基底和时基抖动、垂直噪声的关系

  • 数字示波器的抖动噪声基底(Jitter Noise Floor)指标经常被误会和误用,因此我们认为有必要澄清抖动噪声基底指标到底是什么含义,从而使用户能准确地评估仪器的具有的抖动测量能力。数字示波器抖动噪声基底和时基抖动、垂直噪声有什么关系? 让我们先直接来说明这些术语的含义吧。 抖动噪声基底是示波器本身对抖动测量结果贡献的整体噪声,它经常被标定为统计结果,用有效值或标准偏差值(在平均值为零时,标准偏差值和有效值相同)来表示。如果抖动噪声基底远小于您希望测量的信号抖动,那么示波器是您测量该抖
  • 关键字: 数字示波器  抖动噪声  基底  时基抖动  垂直噪声  

数字示波器的DSO体系结构及功能

  • 数字存储示波器(通常称为 DSO)是为了弥补模拟示波器的诸多不足而发明的。 DSO 输入一个信号,并通过模数转换器将其数字化。图 显示了是德科技数字示波器采用的一种 DSO 体系结构。数字示波器的体系结构衰减器会调整波形。垂直放大器会在波形传到模数转换器(ADC)时做进一步的调整。ADC 会对收到的信号进行采样和数字转换,随后将这个数据存入存储器中。触发器会寻找触发事件,而时基会调整示波器的时间显示。在示波器显示信号之前,微处理器系统可以执行您指定的其他后期处理任务。数据以数字形式表示,可使示波器执行各种
  • 关键字: 数字示波器  DSO  

2023年度业绩快报来了!营收增长21.50%

  • 2025-08-03晚,公司发布2023年度业绩快报。2023年度,鼎阳科技营业收入48,322.80万元,同比增长21.50%,维持良好增长势头;其中,报告期内高端产品营业收入同比增长55.00%,高分辨率数字示波器境内收入同比增长68.77%,射频微波类产品境内同比增长59.70%。业绩连续多年实现强劲增长,营收创成立来新高鼎阳科技本期内营业总收入达48,322.80万元,同比2022年增长21.50%,不仅营收保持了多年来的稳健增长,也创造了建立十几年来的新高。这一数据的提升不仅反映了公司产品配套能
  • 关键字: 鼎阳科技  数字示波器  射频微波  

FPGA:动手实践 - 数字示波器

  • 让我们构建一个简单的数字示波器。单通道,约100 MSPS(每秒兆采样)基于 RS-232(我们也会研究 USB)便宜的!简单的数字示波器配方使用 KNJN.com 的零件,以下是我们所需的基本项目。1 x Pluto FPGA 板,带 TXDI 和电缆(item#6120 和 #6130)1 x Flash 100MHz 采集板 (item#1206 )BNC 连接器 + 尼龙支架 + 连接器 2x8 (item#1250 + #1270 + #1275 )这是它们的样子。我们还需要以下物品(
  • 关键字: FPGA  数字示波器  

FPGA:示波器 华丽的干涉图案

  • flashy 板的输入带宽远高于 Nyquest 的最大理论值 40MHz(我们在这里使用的是时钟频率为 80MHz的 Flashy)。那么,如果我们向 Flashy 提供高于 40MHz 的信号会发生什么?测试设置测试装置由一个直接连接到 Flashy 的HP8640B信号发生器组成。该发生器能够产生高达550MHz的正弦波。干涉图案首先,信号发生器关闭。我们应用一个1.000MHz的测试信号,并校准输出。 让我们在这里得到 7 个垂直除法。如果我们应用 80MHz 信号...迹线保持平坦(因为我们的采
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数字示波器 - 历史、功能、屏幕截图

  • 软件开发早在 2003 年,该软件就启动了。这是在设计周期开始时获取的第一批屏幕截图之一。图形用户界面GUI 变化很快。这是更高版本。触发器像所有普通示波器一样,有 3 种触发器:单次:显示一次跟踪(发生触发时)。与“手臂”按钮配合使用。正常:每次触发发生时显示跟踪,如果触发器未发生,则不显示任何内容。自动:触发时显示跟踪,如果半秒内没有触发,则仍然显示跟踪。坚持添加了持久性功能,可以一次记住和显示多达 16 帧(它会淡化旧帧)。周期重建(“样本等效时间”技术)一个有趣的功能是能够显示一个周期(周期信号)
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Flashy 采集板

  • Flashy是一款高速模拟采集板。它通常与FPGA板一起使用,以创建数字示波器。这是一个单通道 Flashy(顶板),带有 BNC 连接器和 Pluto-II(底板)。 该组合构成了单通道 100MSPS(每秒兆采样数)数字示波器。Flashy 板有三种速度等级:具有ADC60的08060MHz振荡器(典型工作频率范围为20MHz至70MHz)具有ADC100的08100MHz振荡器(典型工作频率范围为20MHz至125MHz)125MHz/133MHz振荡器,带ADC08200(典型工作频率范
  • 关键字: FPGA  数字示波器  Flashy 采集板  

FPGA:数字示波器 4 - 更多功能

  • 现在示波器骨架已开始工作,可以轻松添加更多功能。边沿斜率触发让我们添加在上升沿或下降沿触发的能力。 任何示波器都可以做到这一点。我们需要一点信息来决定我们想要触发的方向。 让我们使用 PC 发送的数据的 bit-0。assign Trigger = (RxD_data[0] ^ Threshold1) & (RxD_data[0] ^ ~Threshold2);这很容易。更多选项让我们添加控制触发阈值的功能。 这是一个 8 位值。 然后我们需要水平采集速率控制、滤波控制...... 这需
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FPGA:数字示波器 3 - 触发器

  • 我们的第一个触发因素很简单 - 我们检测到上升沿越过固定阈值。 由于我们使用的是 8 位 ADC,因此采集范围从 0x00 到 0xFF。因此,让我们暂时将阈值设置为0x80。检测上升沿如果样本高于阈值,但前一个样本低于阈值,则触发!reg Threshold1, Threshold2;always @(posedge clk_flash) Threshold1 <= (data_flash_reg>=8'h80);always @(posedg
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FPGA:数字示波器 2 - 双端口 RAM

  • FIFO使我们能够非常快速地获得工作设计。但对于我们简单的示波器来说,这有点矫枉过正。我们需要一种机制来存储来自一个时钟域(100MHz)的数据,并在另一个时钟域(25MHz)中读取数据。 一个简单的双端口RAM就可以做到这一点。 缺点是两个时钟域之间的所有同步(FIFO为我们所做的)现在必须“手动”完成。触发“基于 FIFO”的示波器设计没有明确的触发机制。让我们改变一下。 现在,每次从串行端口接收到字符时,示波器都会被触发。 当然,这仍然不是一个非常有用的设计,但我们稍后会对其进行改进。我们使用“as
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FPGA:数字示波器 1 - 首款设计

  • 以下是此处构建的内容:FPGA 接收两个时钟:一个缓慢的“系统”时钟,固定在25MHz。ADC采样时钟(更快,假设100MHz),连接到ADC和FPGA。拥有这两个时钟为设计提供了灵活性。 但这也意味着我们需要一种方法将信息从一个时钟域传输到另一个时钟域。 为了验证硬件是否正常工作,让我们走一条简单的路线,使用FIFO。 从ADC采集的样本以全ADC速度(100MHz)存储在FPGA FIFO中。然后,FIFO内容被读回、序列化,并以更慢的速度(115200波特)在串行端口上发送。 最后,我们将串行输出连
  • 关键字: FPGA  数字示波器  
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数字示波器介绍

数字示波器是数据采集,A/D转换,软件编程等一系列的技术制造出来的高性能示波器。数字示波器一般支持多级菜单,能提供给用户多种选择,多种分析功能。还有一些示波器可以提供存储,实现对波形的保存和处理。 目前高端数字示波器主要依靠美国技术,对于300MHz带宽之内的示波器,目前国内品牌RIGOL做的示波器在性能上已经可以和国外品牌抗衡,且具有明显的性价比优势。 [ 查看详细 ]

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